Capítulo 5 El procesador Félix García Carballeira Jesús Carretero Pérez José Daniel Sánchez García David Expósito Singh © Ediciones Paraninfo1.

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1 Capítulo 5 El procesador Félix García Carballeira Jesús Carretero Pérez José Daniel Sánchez García David Expósito Singh © Ediciones Paraninfo1

2 2 Figura 5.1: Componentes básicos de un computador

3 © Ediciones Paraninfo3 Figura 5.2: Estructura de un procesador elemental

4 © Ediciones Paraninfo4 Figura 5.3: Esquema de un registro y señales necesarias para su utilización

5 © Ediciones Paraninfo5 Figura 5.4: Estructura de una ALU y su conexión al banco de registros

6 © Ediciones Paraninfo6 Figura 5.5: Buffer triestado y tabla de funcionamiento

7 © Ediciones Paraninfo7 Figura 5.6: Cronograma de acceso a la memoria del procesador de la Figura 5.2

8 © Ediciones Paraninfo8 Figura 5.7: Camino de datos para la ejecución de la microoperación MAR PC

9 © Ediciones Paraninfo9 Figura 5.8: Señales de control a activar para la ejecución de la operación elemental MAR PC. El resto de señales permanecen inactivas

10 © Ediciones Paraninfo10 Figura 5.9: Ciclo de instrucción con tratamiento de interrupciones

11 © Ediciones Paraninfo11 Figura 5.10: Interrupciones vectorizadas

12 © Ediciones Paraninfo12 Figura 5.11: Entradas y salidas de la unidad de control

13 © Ediciones Paraninfo13 Figura 5.12: Esquema del computador que ejecuta las instrucciones add, lw, sw y bz

14 © Ediciones Paraninfo14 Figura 5.13: Máquina de estados correspondiente al procesador de la Figura 5.12, que ejecuta las instrucciones add, lw, sw y bz

15 © Ediciones Paraninfo15 Figura 5.14: Ejemplo de circuito que implementa la unidad de control para las instrucciones add, lw, sw y bz

16 © Ediciones Paraninfo16 Figura 5.15: Formato de microinstrucción y microprogramas para el procesador de la Figura 5.12, que ejecuta las instrucciones add, lw, sw y bz

17 © Ediciones Paraninfo17 Figura 5.16: Esquema de una unidad de control microprogramada

18 © Ediciones Paraninfo18 Figura 5.17: Ejemplo de unidad de control microprogramada con secuenciamiento implícito para el procesador de la Figura 5.12, que ejecuta las instrucciones add, lw, sw y bz

19 © Ediciones Paraninfo19 Figura 5.18: Esquema del procesador de los Problemas 5.4 y 5.5

20 © Ediciones Paraninfo20 Figura 5.19: Formato de instrucciones del Problema 5.6

21 © Ediciones Paraninfo21 Figura 5.20: Formato instrucciones del Problema 5.7

22 © Ediciones Paraninfo22 Figura 5.21: Contenido de la memoria del ejercicio 5.7

23 © Ediciones Paraninfo23 Figura 5.22: Esquema de unidad de control microprogramada del Problema 5.8

24 © Ediciones Paraninfo24 Figura 5.23: Esquema de la unidad de control microprogramada del Problema 5.10

25 © Ediciones Paraninfo25 Figura 5.24: Esquema de la CPU del problema propuesto 5.2

26 © Ediciones Paraninfo26 Figura 5.25: Esquema de la CPU del problema propuesto 5.3

27 © Ediciones Paraninfo27 Figura 5.26: Esquema del procesador de los Problemas 5.4 y 5.5