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Desarrollo de soft IP cores para el control de dispositivos de E/S
Ingeniería Electrónica Proyectos 2002 Desarrollo de soft IP cores para el control de dispositivos de E/S Francisco Javier Pérez Gómez
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Objetivo IP Cores Lógica programable (FPGA) VHDL
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Etapas del diseño Validación funcional (simulación) Síntesis
Implementación
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Señales de vídeo (I) Colores RGB Barridos
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Señales de vídeo (II) Compresión Sensibilidad ojo humano
Separación luminancia y color (CSC) Reducción ancho de banda Modulación (Video compuesto) Efecto parpadeo Barrido entrelazado
6
Conversión espacio de color
Señales de vídeo (III) Conversión espacio de color Video compuesto
7
Señales de vídeo (IV) Barrido entrelazado Barrido progresivo
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Placa de prototipado
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Diseño (I) Diagrama de bloques
10
Diseño (II) Descripción RT + controlador
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Diseño (III) Diagrama estados controlador
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Integración video - PC
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